基于DSP和CPLD的高精度頻率測量系統設計

介紹了以CPLD(Complex Programmable Logic Device)為核心處理芯片的頻率測量系統,整個系統由信號調理電路、CPLD和DSP等構成,在CPLD中設計等精度測頻模塊,再由DSP進行數字濾波并將采集值送至雙口RAM以供上位機讀取.采用CPLD 配合DSP的設計方案,具有速度高、精度高的優點,且易于升級和擴展采集能力,具有一定的工程應用價值.

作 者： 席鵬 李軍 於二軍 XI Peng LI Jun YU Er-jun   作者單位： 中國航空計算技術研究所,陜西,西安,710068  刊 名： 航空計算技術  ISTIC 英文刊名： AERONAUTICAL COMPUTING TECHNIQUE  年，卷(期)： 2010 40(2)  分類號： V2  關鍵詞： 頻率測量   CPLD   DSP  

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